다양한 에피택셜 성장 조건이 SIC 장치 성능에 미치는 영향은 무엇입니까?
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에피택셜 성장은 탄화규소(SiC) 소자 제조에 있어 중요한 공정으로, 고전력, 고주파수, 고온 응용 분야에서 우수한 성능으로 높은 평가를 받고 있습니다. SiC 장치 공급업체로서 저는 다양한 에피택셜 성장 조건이 SiC 장치의 성능에 얼마나 큰 영향을 미칠 수 있는지 직접 목격했습니다. 이 블로그에서는 다양한 에피택셜 성장 조건이 SiC 장치 성능에 미치는 다양한 영향을 살펴보겠습니다.
1. 성장온도의 영향
에피택셜 성장 중 성장 온도는 가장 중요한 요소 중 하나입니다. 일반적으로 성장 온도가 높을수록 원자의 표면 이동이 향상되어 더욱 완벽한 결정 구조를 얻을 수 있습니다. 온도가 높으면 원자는 기판 표면에서 이동하고 가장 안정적인 격자 위치를 찾는 데 충분한 에너지를 갖습니다. 이는 에피택셜층의 결함 밀도를 낮추는 결과를 가져온다.
SiC 쇼트키 다이오드의 경우 에피택셜 층의 결함 밀도가 낮으면 누설 전류를 줄일 수 있습니다. 누설 전류는 전력 손실을 초래하고 장치의 신뢰성에 영향을 미칠 수 있으므로 쇼트키 다이오드에서 바람직하지 않은 특성입니다. 에이식 쇼트키 다이오드적절한 고온에서 성장된 고품질 에피택시층을 사용하면 보다 안정적인 역바이어스 특성을 갖게 되어 전력 변환 회로에서 보다 효율적으로 작동할 수 있습니다.
반면에 극도로 높은 온도는 몇 가지 문제를 일으킬 수도 있습니다. 예를 들어, SiC 표면에서 실리콘이 증발하여 재료의 화학양론을 방해할 수 있습니다. 이로 인해 새로운 유형의 결함이 발생하고 SiC MOSFET의 성능이 저하될 수 있습니다. 에이식 모스펫게이트 산화물과 SiC 채널 사이의 인터페이스를 정밀하게 제어해야 합니다. 고온 성장으로 인한 SiC 화학량론의 편차는 인터페이스 트랩 밀도의 증가로 이어질 수 있으며, 이는 결국 채널 이동도를 저하시키고 MOSFET의 온 저항을 증가시킵니다.
반대로, 낮은 성장 온도는 원자가 효과적으로 이동하는 데 충분한 에너지를 제공하지 못할 수 있습니다. 이는 에피택셜 층에서 더 높은 밀도의 적층 결함 및 전위를 초래할 수 있습니다. SiC 장치에서 이러한 결함은 전하 캐리어의 재결합 센터 역할을 하여 캐리어 수명을 단축시킬 수 있습니다. 캐리어 수명이 짧을수록 특히 고주파 애플리케이션에서 SiC 장치의 스위칭 속도가 제한될 수 있습니다.
2. 성장률의 영향
에피택셜 층의 성장 속도도 SiC 장치의 성능을 결정하는 데 중요한 역할을 합니다. 높은 성장률은 제조 공정의 처리량을 증가시켜 경제적으로 유리합니다. 그러나 성장률이 매우 높으면 에피택셜 층에 더 많은 불순물과 결함이 포함될 수 있습니다.
성장률이 너무 높으면 원자가 기판 표면에 질서 있게 배열될 시간이 충분하지 않습니다. 이는 단결정 구조 대신 다결정 또는 미세결정 구조를 초래할 수 있습니다. SiC 쇼트키 다이오드에서 다결정 에피택셜 층은 전류 분포를 불균일하게 만들어 국부적인 과열과 장치 신뢰성 저하를 초래할 수 있습니다.
고품질 에피택셜 층을 보장하려면 일반적으로 적당한 성장 속도가 선호됩니다. 적당한 성장률에서 아톰은 이동하여 잘 정돈된 결정 격자를 형성하는 데 충분한 시간을 갖습니다. 이는 항복 전압 및 캐리어 이동성과 같은 SiC 장치의 전기적 특성을 향상시킬 수 있습니다. SiC MOSFET의 경우 잘 정돈된 에피택셜 레이어는 더 부드러운 채널 표면을 제공할 수 있으며, 이는 높은 채널 이동성과 낮은 온 저항을 달성하는 데 필수적입니다.
3. 가스 조성의 역할
에피택셜 성장 중 가스 조성은 또 다른 중요한 요소입니다. SiC 에피택셜 성장에 일반적으로 사용되는 화학 기상 증착(CVD) 공정에서 전구체 가스는 에피택셜 층의 품질을 결정하는 데 중요한 역할을 합니다.
실리콘 함유 가스와 탄소 함유 가스의 비율이 특히 중요합니다. SiC 재료의 화학량론을 유지하려면 적절한 Si/C 비율이 필요합니다. Si/C 비율이 너무 높으면 과잉 실리콘이 에피택셜 층에 통합되어 실리콘이 풍부한 상을 형성할 수 있습니다. 이러한 실리콘이 풍부한 위상은 전하 캐리어의 트랩 역할을 하여 SiC 장치의 캐리어 이동도를 줄이고 누설 전류를 증가시킬 수 있습니다.
반대로, Si/C 비율이 너무 낮으면 탄소가 풍부한 상이 형성될 수 있습니다. 탄소가 풍부한 상은 결함을 유발하고 SiC 장치의 전기적 성능을 저하시킬 수도 있습니다. 예를 들어, SiC 쇼트키 다이오드에서 탄소가 풍부한 영역은 쇼트키 장벽 높이의 국지적 변화를 유발하여 이상적이지 않은 전류-전압 특성을 초래할 수 있습니다.
Si/C 비율 외에도 도펀트 가스의 존재도 SiC 장치의 성능에 영향을 미칩니다. 도펀트는 에피택셜 층의 전도성 유형과 캐리어 농도를 제어하는 데 사용됩니다. 예를 들어, 질소는 SiC의 일반적인 n형 도펀트입니다. 가스 혼합물의 질소 농도는 정밀하게 제어되어야 합니다. 과도한 양의 질소는 높은 캐리어 농도로 이어질 수 있으며, 이는 누설 전류를 증가시키고 SiC 장치의 항복 전압을 감소시킬 수 있습니다. 반면, 질소량이 부족하면 캐리어 농도가 낮아져 SiC MOSFET의 온 저항이 높아질 수 있습니다.
4. 기판 방향
SiC 기판의 방향은 에피택셜 성장과 SiC 장치의 성능에도 큰 영향을 미칩니다. 기판 방향이 다르면 표면 에너지와 원자 배열이 다르며, 이는 성장 모드와 에피택셜 층의 품질에 영향을 미칠 수 있습니다.
가장 일반적으로 사용되는 SiC 기판 방향은 (0001) 및 (000 - 1) 평면입니다. Si 면이라고도 알려진 (0001) 평면은 (000 - 1) 평면 또는 C 면과 비교하여 성장 거동이 다릅니다. Si 면의 에피택셜 성장은 일반적으로 C 면에 비해 표면이 더 매끄럽고 결함 밀도가 더 낮습니다.
SiC 쇼트키 다이오드에서는 Si 면의 표면이 더 매끄러워지면 더 균일한 쇼트키 장벽이 형성되어 장치의 전기적 특성이 향상됩니다. SiC MOSFET의 경우 게이트 산화물과 SiC 채널 사이의 인터페이스가 더 중요합니다. Si 페이스는 보다 안정적인 인터페이스를 제공하여 인터페이스 트랩 밀도를 줄이고 채널 이동성을 향상시킬 수 있습니다.
하지만 C페이스의 성장에도 장점이 있습니다. C 면은 경우에 따라 더 높은 성장률을 가질 수 있으며, 이는 제조 공정의 처리량을 늘리는 데 도움이 될 수 있습니다. 그러나 SiC 장치의 성능을 보장하려면 C 면의 높은 결함 밀도를 주의 깊게 관리해야 합니다.
5. 성장 중 압력
에피택셜 성장 공정 중 압력도 SiC 장치의 성능에 영향을 미칠 수 있습니다. 저압 에피택시 성장은 기상 반응 가능성과 불순물 혼입을 줄일 수 있습니다. 낮은 압력에서는 가스 분자의 평균 자유 경로가 길어져 에피택셜 층의 균일성이 향상될 수 있습니다.
저압 환경에서는 원자가 기판 표면에 더 직접적으로 도달할 수 있어 다른 가스 분자와의 충돌 가능성이 줄어듭니다. 이를 통해 성장 프로세스를 더욱 정밀하게 제어하고 에피택셜 층의 품질을 높일 수 있습니다. SiC MOSFET의 경우 저압 성장 에피택셜 층은 더 낮은 밀도의 인터페이스 트랩을 가질 수 있으며 이는 장치의 전기적 성능을 향상시키는 데 도움이 됩니다.
반면, 고압 성장은 증착 속도를 증가시킬 수 있습니다. 그러나 이는 또한 기체상 반응 및 불순물 혼입 가능성이 더 높아질 수도 있습니다. 고압 성장은 표면 형태를 더욱 거칠게 만들어 SiC 장치의 전기적 특성에 영향을 줄 수도 있습니다.
결론
결론적으로, 성장 온도, 성장 속도, 가스 조성, 기판 방향 및 압력을 포함한 다양한 에피택셜 성장 조건은 SiC 장치의 성능에 큰 영향을 미칩니다. SiC 장치 공급업체로서 우리는 고품질 SiC 장치 생산을 보장하기 위해 이러한 성장 조건을 최적화하는 것이 중요하다는 것을 이해하고 있습니다.
우리는 에피택셜 성장 프로세스를 미세 조정하기 위해 연구 개발에 상당한 시간과 자원을 투자했습니다. 이러한 성장 조건을 세심하게 제어함으로써 당사는 우수한 전기적 성능, 높은 신뢰성 및 장기 안정성을 갖춘 SiC 쇼트키 다이오드 및 SiC MOSFET을 생산할 수 있습니다.
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참고자료
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- 장, X., & 쿠머, C.(2021). 실리콘 카바이드 전력 장치의 발전. 존 와일리 앤 선즈.
